基于L64724的卫星解码机顶盒设计

文章摘要：由于该芯片的参数要求较高，因此，建议用户将直流供电电压VDD设置在3.14～3.47V之间，工作温度TA范围为0～70℃，机箱温度Tc为0～85℃。在TA=25℃，VIN=3.3V，频率为1MHz时，最好使用5pF垢电容作为输入电容CIN和输出电容COUT。表3 参数配置参 数高速率数据低速率数据传输速率42.6Mbps(21.3Mbaud)4.0Mbps(2.0Mbaud)ADC采样频率50MHz23.75MHz晶振频率15MHz15MHzADC模拟输入峰峰值为1.0V峰峰值为1.0V直流补偿控制不用不用维特比码率1/21/2Eb/No4.0dB4.0dB模式DVBDVB5 L64724的

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由于该芯片的参数要求较高，因此，建议用户将直流供电电压VDD设置在3.14～3.47V之间，工作温度TA范围为0～70℃，机箱温度Tc为0～85℃。在TA=25℃，VIN=3.3V，频率为1MHz时，最好使用5pF垢电容作为输入电容CIN和输出电容COUT。

表3 参数配置

参  数 高速率数据 低速率数据 传输速率 42.6Mbps(21.3Mbaud) 4.0Mbps(2.0Mbaud) ADC采样频率 50MHz 23.75MHz 晶振频率 15MHz 15MHz ADC模拟输入 峰峰值为1.0V 峰峰值为1.0V 直流补偿控制 不用 不用 维特比码率 1/2 1/2 Eb/No 4.0dB 4.0dB 模式 DVB DVB

5 L64724的典型应用

    L64724的使用，首先必须注意其内部或外部的各种接口，包括信道接口、信道时钟接口、信道数据输出接口、PLL接口、A/D接口、AGC/时钟控制接口、微控制器接口、控制信号接口等。其中信道接口（channel interface）用于从卫星调谐电路接收输入信号，信道时钟用来标示数据时钟，为上升沿触发。信道数据输出接口是L64724送出数据的通路。在译码器机顶盒的实现电路中，该接口一般应连接到复用器的输入口。微控制器接口用于将芯片与微控制器相连。控制信号接口用来控制L64724的工作。

    L64724是一种可编程逻辑器件，我们可以通过对其接口和内部寄存器设置的改变来使其满足不同的需要。需时钟和输入数据是决定电路稳定性的关键。

5.1 数据和时钟控制方案

    如图2所示，L64724中的输入时钟信号CLK可用来实现信道译码系统中的可能配置，它由外部晶振产生，同时由CLK通过内部锁相环PLL来产生采样时钟PCLK，以便用来驱动模数转换器（ADC）、解调器、前向纠错（FEC）等三个模块。PCLK最高可工作在90MHz左右。由晶振产生的CLK可作为PLL的基准时钟，一般在15～60MHz之间。控制时钟LCLK是PLL经CLK-DIV2分频得到的，即LCLK=CLK/CLK-DIV2。

5.2 L64724的应用电路

    L64724是一种功能很全面的芯片，笔者在电路的应用过程中深深体会到了它优越灵活的性能。L64724主要用于卫星数字电视接收机实现电路，它是按欧洲的DVB标准中的卫星传输方案来设计的。用这种芯片可在接收机盒的设计中起到事半功倍的效果。图3所示是一种机顶盒设计的电路方案，它主要包含三部分，其核心部分是由L64724组成的卫星译码器，还有由L64008组成的将MPEG-2码流传输到去复用器的电路以及由L64005构成的视频/音频译码器。当电路接收到由卫星传来的信号后，由调谐电路选出有用信号送入L64724，在信号进入L64724之后先由前端将模拟信号采样变为数字信号，并在L64724内部进行可编程设定所需参数，在达到规定性能指标后，再通过串行总线控制传入L64008去复用器进行处理。最后与DRAM交换数据并将结果送入L64005经视频译码后变为所需的音频和视频信号并分两路输出。而图3中的串行数据总线则通过编程控制片内各单元，片内各单元的信息获得均由该总线提供。

5.3 电路设计中的参数配置

    在L64724的应用中，可通过微控制器接口对片内的参数进行配置，以达到最优性能。为方便读者应用。表3提供了一组分别适用于高、低数据速度的QPSK解调和FEC的配置参数，该配置是经实验验证较为优化的一组参数，可供读者参考。

6 结束语

     该卫星解码接收电路可在上述电路中对L64724的参数进行设定，包括对传输速率、ADC采样频率、晶振频率、内码的码率等进行编程控制。对于不同的参数配置，各引脚的接法也有所不同，同时还应注意芯片的工作条件，以免使芯片遭到永久性损坏。本文所介绍的电路及参数均经实践验证，是一种较为优化的电路配置，也是卫星传输体系中高清晰数字电视接收机的核心电路。

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