非多路复用与多路复用总线转换桥的设计与实现

文章摘要：３．３ 读操作转换过程通过软件等待设置，使ＤＳＰ的 Ｉ／Ｏ读、写操作需四个机器时钟周期。在第一个时钟周期的上升沿产生ａｌｅ信号（脉宽为０．５倍的机器时钟周期），同时将ＤＳＰ输入的低八位地址ｆａｂｌ７锁存并送到地址数据复用总线ａｄｂ７，并保持到第二个时钟周期的上升沿为止，此时ａｄｂ７为高阻状态。第三、第四个时钟周期，ＤＳＰ的读信号ｆｒｄ有效，将此信号直接送到ｒｄ引脚，此时ａｄｂ７引脚的数据直接送给ｆｄｂ７引脚，读操作结束。图5 转换桥的时序仿真图 ３．４ 写操作转换过程在写操作的四个时钟周期中，在第一个时钟周期的上升沿产生ａｌｅ信号（脉宽为一个机器时钟周期），同时将ＤＳＰ输入的低八位地址ｆ

非多路复用与多路复用总线转换桥的设计与实现,标签：fpga是什么,fpga教程,http://www.88dzw.com

３．３ 读操作转换过程

通过软件等待设置，使ＤＳＰ的 Ｉ／Ｏ读、写操作需四个机器时钟周期。在第一个时钟周期的上升沿产生ａｌｅ信号（脉宽为０．５倍的机器时钟周期），同时将ＤＳＰ输入的低八位地址ｆａｂｌ７锁存并送到地址数据复用总线ａｄｂ７，并保持到第二个时钟周期的上升沿为止，此时ａｄｂ７为高阻状态。第三、第四个时钟周期，ＤＳＰ的读信号ｆｒｄ有效，将此信号直接送到ｒｄ引脚，此时ａｄｂ７引脚的数据直接送给ｆｄｂ７引脚，读操作结束。

图5 转换桥的时序仿真图

    ３．４ 写操作转换过程

在写操作的四个时钟周期中，在第一个时钟周期的上升沿产生ａｌｅ信号（脉宽为一个机器时钟周期），同时将ＤＳＰ输入的低八位地址ｆａｂｌ７引脚的信号送到ａｄｂ７上，并保持到第三个时钟周期结束。在第四个时钟周期的上升沿产生写信号ｗｒ（宽度为一个时钟周期），在ＤＳＰ写信号ｆｅｗ的上升沿处锁存数据线ｆｄｂ７来的信号，并将其送到ａｄｂ７引脚上，延时到第五个时钟周期时把ａｄｂ７变为高阻状态，写操作结束。

本文提出的非多路复用总线到多路复用总线转换桥采用了Ｘｉｌｉｎｘ公司的ＣＰＬＤ芯片ＸＣ９５１４４－１５－ＰＱ１００，并使用该公司开发的集成环境Ｆｕｎｄａｔｉｏｎ Ｆ３．１ｉ，将其集成为一块专用芯片。通过大量的实验测试，此转换桥工作非常稳定，现已应用到电力网络馈线远程终端装置（ＦＴＵ）中。

上一页  [1] [2] [3]